Reconfiguration Dynamique des deux Niveaux Caches L1 et L2 : MPSoC A Architecture Homogène
Presses Académiques Francophones, 2015
Poche
BENGUEDDACH, Asmaa
Essais littéraires
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Résumé
La hiérarchie mémoire contribue largement à la consommation énergétique des MPSoC (Multi-Processors-System-On-Chip). Dans ce Livre, nous présentons une technique de réglage de deux niveaux de caches (nommés L1 et L2) basée sur une exploration intelligente des paramètres du cache : taille totale, taille de la ligne et l'associativité...
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